summaryrefslogtreecommitdiffstats
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space:
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-rw-r--r--src/intel/genxml/gen7.xml228
-rw-r--r--src/intel/genxml/gen75.xml228
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-rw-r--r--src/intel/genxml/gen9.xml228
-rw-r--r--src/intel/isl/isl_surface_state.c6
-rw-r--r--src/intel/vulkan/genX_gpu_memcpy.c2
-rw-r--r--src/intel/vulkan/genX_pipeline.c6
-rw-r--r--src/mesa/drivers/dri/i965/genX_state_upload.c8
15 files changed, 35 insertions, 2269 deletions
diff --git a/src/intel/blorp/blorp_genX_exec.h b/src/intel/blorp/blorp_genX_exec.h
index 7182399c9c2..1348659233c 100644
--- a/src/intel/blorp/blorp_genX_exec.h
+++ b/src/intel/blorp/blorp_genX_exec.h
@@ -390,7 +390,7 @@ blorp_emit_vertex_elements(struct blorp_batch *batch,
ve[slot] = (struct GENX(VERTEX_ELEMENT_STATE)) {
.VertexBufferIndex = 1,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32A32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32A32_FLOAT,
.SourceElementOffset = 0,
.Component0Control = VFCOMP_STORE_SRC,
@@ -422,7 +422,7 @@ blorp_emit_vertex_elements(struct blorp_batch *batch,
ve[slot] = (struct GENX(VERTEX_ELEMENT_STATE)) {
.VertexBufferIndex = 0,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32_FLOAT,
.SourceElementOffset = 0,
.Component0Control = VFCOMP_STORE_SRC,
.Component1Control = VFCOMP_STORE_SRC,
@@ -436,7 +436,7 @@ blorp_emit_vertex_elements(struct blorp_batch *batch,
ve[slot] = (struct GENX(VERTEX_ELEMENT_STATE)) {
.VertexBufferIndex = 0,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32_FLOAT,
.SourceElementOffset = 0,
.Component0Control = VFCOMP_STORE_SRC,
.Component1Control = VFCOMP_STORE_SRC,
@@ -461,13 +461,13 @@ blorp_emit_vertex_elements(struct blorp_batch *batch,
.SourceElementOffset = 0,
.Component0Control = VFCOMP_STORE_SRC,
#if GEN_GEN >= 9
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32A32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32A32_FLOAT,
.Component1Control = VFCOMP_STORE_SRC,
.Component2Control = VFCOMP_STORE_SRC,
.Component3Control = VFCOMP_STORE_SRC,
#else
/* Clear colors on gen7-8 are for bits out of one dword */
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32_FLOAT,
.Component1Control = VFCOMP_STORE_0,
.Component2Control = VFCOMP_STORE_0,
.Component3Control = VFCOMP_STORE_0,
@@ -479,7 +479,7 @@ blorp_emit_vertex_elements(struct blorp_batch *batch,
ve[slot] = (struct GENX(VERTEX_ELEMENT_STATE)) {
.VertexBufferIndex = 1,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32A32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32A32_FLOAT,
.SourceElementOffset = 16 + i * 4 * sizeof(float),
.Component0Control = VFCOMP_STORE_SRC,
.Component1Control = VFCOMP_STORE_SRC,
@@ -1356,7 +1356,7 @@ blorp_emit_null_surface_state(struct blorp_batch *batch,
{
struct GENX(RENDER_SURFACE_STATE) ss = {
.SurfaceType = SURFTYPE_NULL,
- .SurfaceFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R8G8B8A8_UNORM,
+ .SurfaceFormat = ISL_FORMAT_R8G8B8A8_UNORM,
.Width = surface->surf.logical_level0_px.width - 1,
.Height = surface->surf.logical_level0_px.height - 1,
.MIPCountLOD = surface->view.base_level,
diff --git a/src/intel/genxml/gen10.xml b/src/intel/genxml/gen10.xml
index 47c679a3fa9..2d36957c2a5 100644
--- a/src/intel/genxml/gen10.xml
+++ b/src/intel/genxml/gen10.xml
@@ -180,231 +180,6 @@
<value name="SET" value="15"/>
</enum>
- <enum name="SURFACE_FORMAT" prefix="SF">
- <value name="R32G32B32A32_FLOAT" value="0"/>
- <value name="R32G32B32A32_SINT" value="1"/>
- <value name="R32G32B32A32_UINT" value="2"/>
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- <value name="R32G32B32A32_SNORM" value="4"/>
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- <value name="R32G32B32A32_SFIXED" value="32"/>
- <value name="R64G64_PASSTHRU" value="33"/>
- <value name="R32G32B32_FLOAT" value="64"/>
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- <value name="R16G16B16A16_SNORM" value="129"/>
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- </enum>
-
<enum name="Shader Channel Select" prefix="SCS">
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@@ -462,7 +237,7 @@
<struct name="VERTEX_ELEMENT_STATE" length="2">
<field name="Vertex Buffer Index" start="26" end="31" type="uint"/>
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- <field name="Source Element Format" start="16" end="24" type="SURFACE_FORMAT"/>
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<field name="Source Element Offset" start="0" end="11" type="uint"/>
<field name="Component 0 Control" start="60" end="62" type="3D_Vertex_Component_Control"/>
@@ -685,7 +460,7 @@
<value name="SURFTYPE_NULL" value="7"/>
</field>
<field name="Surface Array" start="28" end="28" type="bool"/>
- <field name="Surface Format" start="18" end="27" type="SURFACE_FORMAT"/>
+ <field name="Surface Format" start="18" end="27" type="uint"/>
<field name="Surface Vertical Alignment" start="16" end="17" type="uint">
<value name="VALIGN 4" value="1"/>
<value name="VALIGN 8" value="2"/>
diff --git a/src/intel/genxml/gen11.xml b/src/intel/genxml/gen11.xml
index 9a8a2fe21e3..a93b62aa4cf 100644
--- a/src/intel/genxml/gen11.xml
+++ b/src/intel/genxml/gen11.xml
@@ -180,231 +180,6 @@
<value name="SET" value="15"/>
</enum>
- <enum name="SURFACE_FORMAT" prefix="SF">
- <value name="R32G32B32A32_FLOAT" value="0"/>
- <value name="R32G32B32A32_SINT" value="1"/>
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- <value name="R8G8B8_SNORM" value="404"/>
- <value name="R8G8B8_SSCALED" value="405"/>
- <value name="R8G8B8_USCALED" value="406"/>
- <value name="R64G64B64A64_FLOAT" value="407"/>
- <value name="R64G64B64_FLOAT" value="408"/>
- <value name="BC4_SNORM" value="409"/>
- <value name="BC5_SNORM" value="410"/>
- <value name="R16G16B16_FLOAT" value="411"/>
- <value name="R16G16B16_UNORM" value="412"/>
- <value name="R16G16B16_SNORM" value="413"/>
- <value name="R16G16B16_SSCALED" value="414"/>
- <value name="R16G16B16_USCALED" value="415"/>
- <value name="BC6H_SF16" value="417"/>
- <value name="BC7_UNORM" value="418"/>
- <value name="BC7_UNORM_SRGB" value="419"/>
- <value name="BC6H_UF16" value="420"/>
- <value name="PLANAR_420_8" value="421"/>
- <value name="R8G8B8_UNORM_SRGB" value="424"/>
- <value name="ETC1_RGB8" value="425"/>
- <value name="ETC2_RGB8" value="426"/>
- <value name="EAC_R11" value="427"/>
- <value name="EAC_RG11" value="428"/>
- <value name="EAC_SIGNED_R11" value="429"/>
- <value name="EAC_SIGNED_RG11" value="430"/>
- <value name="ETC2_SRGB8" value="431"/>
- <value name="R16G16B16_UINT" value="432"/>
- <value name="R16G16B16_SINT" value="433"/>
- <value name="R32_SFIXED" value="434"/>
- <value name="R10G10B10A2_SNORM" value="435"/>
- <value name="R10G10B10A2_USCALED" value="436"/>
- <value name="R10G10B10A2_SSCALED" value="437"/>
- <value name="R10G10B10A2_SINT" value="438"/>
- <value name="B10G10R10A2_SNORM" value="439"/>
- <value name="B10G10R10A2_USCALED" value="440"/>
- <value name="B10G10R10A2_SSCALED" value="441"/>
- <value name="B10G10R10A2_UINT" value="442"/>
- <value name="B10G10R10A2_SINT" value="443"/>
- <value name="R64G64B64A64_PASSTHRU" value="444"/>
- <value name="R64G64B64_PASSTHRU" value="445"/>
- <value name="ETC2_RGB8_PTA" value="448"/>
- <value name="ETC2_SRGB8_PTA" value="449"/>
- <value name="ETC2_EAC_RGBA8" value="450"/>
- <value name="ETC2_EAC_SRGB8_A8" value="451"/>
- <value name="R8G8B8_UINT" value="456"/>
- <value name="R8G8B8_SINT" value="457"/>
- <value name="RAW" value="511"/>
- </enum>
-
<enum name="Shader Channel Select" prefix="SCS">
<value name="ZERO" value="0"/>
<value name="ONE" value="1"/>
@@ -461,7 +237,7 @@
<struct name="VERTEX_ELEMENT_STATE" length="2">
<field name="Vertex Buffer Index" start="26" end="31" type="uint"/>
<field name="Valid" start="25" end="25" type="bool"/>
- <field name="Source Element Format" start="16" end="24" type="SURFACE_FORMAT"/>
+ <field name="Source Element Format" start="16" end="24" type="uint"/>
<field name="Edge Flag Enable" start="15" end="15" type="bool"/>
<field name="Source Element Offset" start="0" end="11" type="uint"/>
<field name="Component 0 Control" start="60" end="62" type="3D_Vertex_Component_Control"/>
@@ -683,7 +459,7 @@
<value name="SURFTYPE_NULL" value="7"/>
</field>
<field name="Surface Array" start="28" end="28" type="bool"/>
- <field name="Surface Format" start="18" end="27" type="SURFACE_FORMAT"/>
+ <field name="Surface Format" start="18" end="27" type="uint"/>
<field name="Surface Vertical Alignment" start="16" end="17" type="uint">
<value name="VALIGN 4" value="1"/>
<value name="VALIGN 8" value="2"/>
diff --git a/src/intel/isl/isl_surface_state.c b/src/intel/isl/isl_surface_state.c
index 1f729f89f4f..32a5429f2bf 100644
--- a/src/intel/isl/isl_surface_state.c
+++ b/src/intel/isl/isl_surface_state.c
@@ -270,7 +270,7 @@ isl_genX(surf_fill_state_s)(const struct isl_device *dev, void *state,
assert(surf_fmtl->bh == view_fmtl->bh);
}
- s.SurfaceFormat = (enum GENX(SURFACE_FORMAT)) info->view->format;
+ s.SurfaceFormat = info->view->format;
#if GEN_GEN <= 5
s.ColorBufferComponentWriteDisables = info->write_disables;
@@ -718,7 +718,7 @@ isl_genX(buffer_fill_state_s)(void *state,
struct GENX(RENDER_SURFACE_STATE) s = { 0, };
s.SurfaceType = SURFTYPE_BUFFER;
- s.SurfaceFormat = (enum GENX(SURFACE_FORMAT)) info->format;
+ s.SurfaceFormat = info->format;
#if GEN_GEN >= 6
s.SurfaceVerticalAlignment = isl_to_gen_valign[4];
@@ -776,7 +776,7 @@ isl_genX(null_fill_state)(void *state, struct isl_extent3d size)
{
struct GENX(RENDER_SURFACE_STATE) s = {
.SurfaceType = SURFTYPE_NULL,
- .SurfaceFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_B8G8R8A8_UNORM,
+ .SurfaceFormat = ISL_FORMAT_B8G8R8A8_UNORM,
#if GEN_GEN >= 7
.SurfaceArray = size.depth > 0,
#endif
diff --git a/src/intel/vulkan/genX_gpu_memcpy.c b/src/intel/vulkan/genX_gpu_memcpy.c
index 1d527fb1549..eaafcfa3b22 100644
--- a/src/intel/vulkan/genX_gpu_memcpy.c
+++ b/src/intel/vulkan/genX_gpu_memcpy.c
@@ -172,7 +172,7 @@ genX(cmd_buffer_so_memcpy)(struct anv_cmd_buffer *cmd_buffer,
&(struct GENX(VERTEX_ELEMENT_STATE)) {
.VertexBufferIndex = 32,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) format,
+ .SourceElementFormat = format,
.SourceElementOffset = 0,
.Component0Control = (bs >= 4) ? VFCOMP_STORE_SRC : VFCOMP_STORE_0,
.Component1Control = (bs >= 8) ? VFCOMP_STORE_SRC : VFCOMP_STORE_0,
diff --git a/src/intel/vulkan/genX_pipeline.c b/src/intel/vulkan/genX_pipeline.c
index 89cbe293b86..412fb6ac0f9 100644
--- a/src/intel/vulkan/genX_pipeline.c
+++ b/src/intel/vulkan/genX_pipeline.c
@@ -138,7 +138,7 @@ emit_vertex_input(struct anv_pipeline *pipeline,
struct GENX(VERTEX_ELEMENT_STATE) element = {
.VertexBufferIndex = desc->binding,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) format,
+ .SourceElementFormat = format,
.EdgeFlagEnable = false,
.SourceElementOffset = desc->offset,
.Component0Control = vertex_element_comp_control(format, 0),
@@ -184,7 +184,7 @@ emit_vertex_input(struct anv_pipeline *pipeline,
struct GENX(VERTEX_ELEMENT_STATE) element = {
.VertexBufferIndex = ANV_SVGS_VB_INDEX,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32_UINT,
+ .SourceElementFormat = ISL_FORMAT_R32G32_UINT,
.Component0Control = base_ctrl,
.Component1Control = base_ctrl,
#if GEN_GEN >= 8
@@ -214,7 +214,7 @@ emit_vertex_input(struct anv_pipeline *pipeline,
struct GENX(VERTEX_ELEMENT_STATE) element = {
.VertexBufferIndex = ANV_DRAWID_VB_INDEX,
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32_UINT,
+ .SourceElementFormat = ISL_FORMAT_R32_UINT,
.Component0Control = VFCOMP_STORE_SRC,
.Component1Control = VFCOMP_STORE_0,
.Component2Control = VFCOMP_STORE_0,
diff --git a/src/mesa/drivers/dri/i965/genX_state_upload.c b/src/mesa/drivers/dri/i965/genX_state_upload.c
index 0abe8e2d557..211fae58e9d 100644
--- a/src/mesa/drivers/dri/i965/genX_state_upload.c
+++ b/src/mesa/drivers/dri/i965/genX_state_upload.c
@@ -572,7 +572,7 @@ genX(emit_vertices)(struct brw_context *brw)
1 + GENX(VERTEX_ELEMENT_STATE_length));
struct GENX(VERTEX_ELEMENT_STATE) elem = {
.Valid = true,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32B32A32_FLOAT,
+ .SourceElementFormat = ISL_FORMAT_R32G32B32A32_FLOAT,
.Component0Control = VFCOMP_STORE_0,
.Component1Control = VFCOMP_STORE_0,
.Component2Control = VFCOMP_STORE_0,
@@ -766,13 +766,13 @@ genX(emit_vertices)(struct brw_context *brw)
if (vs_prog_data->uses_basevertex ||
vs_prog_data->uses_baseinstance) {
elem_state.VertexBufferIndex = brw->vb.nr_buffers;
- elem_state.SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32_UINT;
+ elem_state.SourceElementFormat = ISL_FORMAT_R32G32_UINT;
elem_state.Component0Control = VFCOMP_STORE_SRC;
elem_state.Component1Control = VFCOMP_STORE_SRC;
}
#else
elem_state.VertexBufferIndex = brw->vb.nr_buffers;
- elem_state.SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32G32_UINT;
+ elem_state.SourceElementFormat = ISL_FORMAT_R32G32_UINT;
if (vs_prog_data->uses_basevertex)
elem_state.Component0Control = VFCOMP_STORE_SRC;
@@ -794,7 +794,7 @@ genX(emit_vertices)(struct brw_context *brw)
struct GENX(VERTEX_ELEMENT_STATE) elem_state = {
.Valid = true,
.VertexBufferIndex = brw->vb.nr_buffers + 1,
- .SourceElementFormat = (enum GENX(SURFACE_FORMAT)) ISL_FORMAT_R32_UINT,
+ .SourceElementFormat = ISL_FORMAT_R32_UINT,
.Component0Control = VFCOMP_STORE_SRC,
.Component1Control = VFCOMP_STORE_0,
.Component2Control = VFCOMP_STORE_0,